基于SRAM技術的Xilinx FPGA具有較高的邏輯密度，消耗較高功率；

基于閃存技術的Xilinx CPLD具有較低的邏輯密度，功耗也比較低。為了提高邏輯密度、集成更多功能，PLD廠商的每一代器件都會采用當前最新的工藝技術。不同的功能需求以及集成工藝，使得PLD的供電電壓有所不同。

由于PLD在電路板上擔當的角色是一個片上系統（SOC），為這些器件供電就相當于為整個系統供電。典型的高端Virtex系列FPGA可能需要10~15路獨立的供電電壓。另一方面，較低密度的Spantan、Kintex、Artix和CoolRunner系列器件會需要2~10路獨立的供電電壓。用戶需要根據每路電壓的功率要求、供電順序以及系統電源管理的需求，確定正確的穩壓電源組合。

現代PLD的核電源為內部多數電路供電，所消耗的功率也最高。每一次新工藝的出現，都會產生新的核電源要求。支持PLD輔助電路的核電電源用于配置邏輯電路、時鐘管理以及其他輔助功能電路。此外，FPGA往往把一個接口標準橋接到另一接口標準，每個IO也會具有不同的電源要求求，范圍從1.2V至3.3V。

另外，特別需要注意告訴SerDes收發器的供電電源，每個收發器可能消耗1至幾個安培的電流，收發器速率為155Mbps至28Gbps，甚至更高。例如100G以太網系統中使用多個這樣的收發器，電流損耗為10A，甚至更高。高速數據傳輸會在電源總線產生較大的噪聲，對電源的性能影響較大。

編輯：jq