PCB一般板廠用SI9000來計算阻抗,但FPC我用SI9000模擬了幾次都不準,剛好*** FPC可以免費打樣了,后面就直接打樣,用TDR方式測出阻抗,再打切片測量銅厚,基材厚度,線寬線距,反推再修正的方式,整了3次才把阻抗線寬及線距整出來,結(jié)果如下:
注:CVL表示只貼了阻焊膜,EMI表示是貼了屏蔽膜的,另外屏蔽膜是接了地的,如果不接地會有影響
以上數(shù)據(jù)是基于FPC板厚0.11mm,基材PI厚度25um,銅厚12um(成品銅厚15-18um)的,不同基材會有所不同,數(shù)據(jù)僅供參考,需要打樣驗證!
審核編輯 黃宇
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發(fā)表于 08-01 17:15
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FPC柔性電路板插拔金手指設(shè)計教材 #電路知識 #FPC #人工智能 #電工知識 #fpc排線 #FPC生產(chǎn)
FPC
孺子牛PCB
發(fā)布于 :2024年06月21日 20:17:07
PCB阻抗設(shè)計12問,輕松帶你搞懂阻抗!
嚴重影響,因此這種走線方式有一定的缺陷。
10 問:高速PCB設(shè)計那些影響阻抗?
答:
1、線寬:阻抗線寬與
發(fā)表于 06-11 10:21
ROGERS高頻板阻抗設(shè)計要求有哪些?
構(gòu);需要用到 雙芯板結(jié)構(gòu),保證信號的穩(wěn)定性,因為芯板中間的介質(zhì)厚度是穩(wěn)定的,保證外層阻抗線信號的穩(wěn)定;下面列舉兩種常見的高頻板阻抗設(shè)計疊層,貴司請按如下疊層去計算,設(shè)計阻抗
掌握了這個分析方法,實現(xiàn)傳輸線阻抗5%的加工公差不是夢!
,然后走線就在L2層了。由于板厚比較薄,也就是L2層的上下層介質(zhì)厚度也很薄,因此我們L2層的線寬自然就設(shè)計得很細了。
疊層和L2層的線寬線距
發(fā)表于 03-25 18:05
掌握了這個分析方法,實現(xiàn)傳輸線阻抗5%的加工公差不是夢!
傳輸線結(jié)構(gòu)很多因素都會影響阻抗,例如線寬、介質(zhì)厚度、介電常數(shù)、銅厚等,那大家有沒有想過到底哪個因素最影響阻抗呢?學會了本文的分析方法,或許有一天阻抗
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