深入開源處理器內(nèi)部，RISC-V技術(shù)分析

譯者? 君謙? 在此特別鳴謝！

本文摘自《開源處理器內(nèi)部—RISC-V簡介》一書,其經(jīng)過格式化和輕編輯,內(nèi)容和頁面布局達(dá)到Elektor期刊的標(biāo)準(zhǔn)。FPGA技術(shù)與(V)HDL的結(jié)合在電子專家中很受歡迎，RISC-V為專業(yè)應(yīng)用增加了開源途徑。在本文中,我們測試了一些在Elektor的“Alchitry”系列的Lattice和 Xilinx FPGA板上運(yùn)行的示例應(yīng)用程序的并行比較以及結(jié)果。

過去,在 FPGA工具流中設(shè)置項(xiàng)目是一項(xiàng)艱巨的任務(wù)。隨著技術(shù)趨于成熟,這種設(shè)置變得簡單許多。在這里的例子中大部分工作已經(jīng)完成。值得注意的是,大型項(xiàng)目或最大限度利用FPGA功能的項(xiàng)目不可避免地會(huì)變得復(fù)雜得多。

具體到Lattice和 Xilinx,除了為項(xiàng)目選擇合適的FPGA目標(biāo)之外,只需要在工具中鏈接到3個(gè)文件。在這種簡化的方法中,所有的項(xiàng)目文件都需要在同一個(gè)目錄中。建議讀者閱讀FPGA的Alchitry教程軟件安裝和項(xiàng)目設(shè)置,這里僅僅涉及基本的細(xì)節(jié)。

1??Lattice( Alchitry Cu)注意事項(xiàng) ? ?

該開發(fā)板使用的FPGA需要 Lattice iCEcube2軟件。這是一款成熟的產(chǎn)品,沒有太多花哨的功能,但有幾點(diǎn)需要注意:

①?確保使用正確的設(shè)備選項(xiàng)設(shè)置項(xiàng)目。Alchitry Cu使用CB132封裝中的 iCE4O系列HX8K器件,所有I/O組都使用3.3V電源。

②?只有yrv_alchitry.v文件需要作為設(shè)計(jì)文件輸入，因?yàn)樗衅渌O(shè)計(jì)文件將自動(dòng)以正確的順序包含在內(nèi)。

③?對于合成工具﹐需確保選擇Lattice LSE合成。邏輯綜合期間不需要約束文件。

④綜合完成后,在運(yùn)行其余工具之前,yrv_ alchitry.pc/pin約束文件和 timing. sdc時(shí)序約束文件需要被鏈接。各種日志文件中會(huì)有許多警告,但是它們都沒有重要到需要采取任何措施。

2??Xilinx ( Alchitry Au和Au＋)注意事項(xiàng) ? ?

在這些開發(fā)板上使用的FPGA需要Xilinx Vivado軟件。這是一個(gè)非常復(fù)雜的產(chǎn)品,本項(xiàng)目僅使用這個(gè)軟件的一小部分功能。這里有一些要記住的事情:

①?只有yrv_alchitry.v文件需要作為設(shè)計(jì)文件輸入。

②?只有yrv_alchitry.mdc約束文件是必需的。該文件包含引腳約束、時(shí)序約束以及編程電壓規(guī)格。

③?正確的器件選項(xiàng)是用于Au板的xc7a35tftg256 -i和用于Au＋板的xc7aiootftgzS6 -i。

在這些設(shè)備的日志文件中有更多的警告﹐同樣,它們都沒有重要到需要采取任何措施。

3??FPGA結(jié)果 ? ?

該示例項(xiàng)目已在所有3種目標(biāo)FPGA開發(fā)板上實(shí)施，具體結(jié)果將在以下部分介紹。在對一些結(jié)果進(jìn)行并列比較時(shí)是很有趣的。表1顯示了100 MHz分頻器的報(bào)告時(shí)鐘速度。

100 MHz分頻器設(shè)計(jì)用于最大速度,觸發(fā)器之間只有一級邏輯,這意味著這個(gè)結(jié)果應(yīng)該代表技術(shù)的能力。如果報(bào)道屬實(shí)﹐點(diǎn)陣設(shè)備的速度令人印象深刻。最有趣的是,隨著邏輯綜合到邏輯布局再到最終布線結(jié)果,報(bào)告的速度變得更快,而且可能更準(zhǔn)確。雖然最終的性能比最初的預(yù)期值要好,但是相差兩倍是不理想的,因?yàn)檫@可能導(dǎo)致錯(cuò)誤地將其作為一個(gè)不可行的項(xiàng)目而放棄。

Xilinx工具不會(huì)在邏輯布局時(shí)給出單獨(dú)的速度估計(jì)，但邏輯綜合和最終結(jié)果之間報(bào)告的速度幾乎相同。從設(shè)計(jì)師的角度來看,這是首選。

表2顯示了項(xiàng)目所需的資源以及CPU本身的最大時(shí)鐘頻率。這些結(jié)果不包括RISC-V特權(quán)架構(gòu)中的任何64位計(jì)數(shù)器。

表2的第二行說明了為什么比較FPGA結(jié)果會(huì)很復(fù)雜。從表中可以看出,Xilinx實(shí)現(xiàn)所需的資源不到1attice實(shí)現(xiàn)所需資源的一半﹐但是Xilinx邏輯無件包含的邏輯比點(diǎn)陣邏輯元件多得多。此外，Xilinx設(shè)計(jì)使用了 Lattice設(shè)備所沒有的專用DSP模塊。

查看所用邏輯元件的百分比,可以發(fā)現(xiàn)3種FPGA之間的尺寸差異。yrv_mcu設(shè)計(jì)需要一半多一點(diǎn)的 Lattice器件,是大約1/10的中端Xilinx器件,不到大型Xilinx 的1/20。這種用法符合不同開發(fā)板的成本要求。

正如預(yù)期的那樣,設(shè)計(jì)所需的觸發(fā)器數(shù)量在3種FPGA中是相似的,確切地說,數(shù)量更多的是邏輯綜合工具的功能而不是其他。邏輯綜合工具將復(fù)制觸發(fā)器以提高性能或簡化布線。

速度行顯示3種 FPGA提供大致相同的性能,這有點(diǎn)令人驚訝,因?yàn)長attice FPGA 不包含Xilinx實(shí)施中使用的專用DSP模塊。

4??關(guān)于Alchitry Cu ? ?

清單1直接摘自 Lattice 的實(shí)現(xiàn)報(bào)告,顯示了資源利用的細(xì)節(jié)。圖1取自Lattice Floorplanner工具的屏幕截圖﹐顯示了分布在器件中的邏輯元件的使用情況。這種分布在整個(gè)設(shè)備中相當(dāng)均勻,盡管總體使用率只有60%左右。

5? 關(guān)于Alchitry Au ? ?

清單2直接摘自Xilinx實(shí)現(xiàn)報(bào)告,顯示了資源利用的細(xì)節(jié)。完整的Xilinx報(bào)告要大得多,涵蓋了FPGA中所有可用的專用硬件。

圖2為Xilinx Floorplanner 工具的屏幕截圖,顯示了分布在整個(gè)器件中的邏輯元件的使用情況,以及專用邏輯模塊如何分布在整個(gè)器件中。放置工具似乎總是從設(shè)備的左下角開始。

6? 關(guān)于Alchitry Au+ ? ?

清單3也直接摘自Xilinx的實(shí)現(xiàn)報(bào)告﹐顯示了資源利用的細(xì)節(jié)。請注意,兩臺(tái)Xilinx設(shè)備使用的資源數(shù)量幾乎相同。圖3也取自Xilinx Floorplanner工具的屏幕截圖。有趣的是,盡管該FPGA包含3倍數(shù)量的邏輯元件,但本例所需的總面積與第一個(gè) Xilinx實(shí)施中幾乎相同。

7? 硬件編程 ? ?

使用Alchitry Loader 程序時(shí),將 FPGA 比特流下載到Alchitry開發(fā)板非常簡單。該獨(dú)立程序作為Alchitry的一部分,自動(dòng)安裝Alchitry提供的實(shí)驗(yàn)室軟件。圖4顯示了這個(gè)程序的用戶界面。

對用于加載FPGA的開發(fā)板上的閃存器件進(jìn)行編程也很簡單,只需指定位流文件、選擇目標(biāo)板,然后單擊“編程”按鈕。

默認(rèn)情況下,程序會(huì)查找.bin類型的比特流文件,這是iCEcube2軟件使用的默認(rèn)設(shè)置。Vivado 軟件生成. bit類型的比特流文件。因此,在加載Xilinx 比特流文件時(shí)要記住這一點(diǎn)。

編輯：黃飛

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處理器(221451) 處理器(221451)
FPGA(591966) FPGA(591966)
Xilinx(119164) Xilinx(119164)
vhdl(127605) vhdl(127605)
RISC-V(44938) RISC-V(44938)

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2017-06-21 19:30:45

MIPS Technologies不再設(shè)計(jì)MIPS處理器。相反，它加入了RISC-V陣營

MIPS Technologies不再設(shè)計(jì)MIPS處理器。相反，它加入了RISC-V陣營，放棄了具有悠久歷史和技術(shù)聯(lián)系的同名架構(gòu)。此舉顯然預(yù)示著MIPS作為CPU系列的終結(jié)，并進(jìn)一步減少了可用處理器

2021-03-09 19:30:07

Occamy RISC-V 前景如何

由歐洲航天局支持，由蘇黎世聯(lián)邦理工學(xué)院和博洛尼亞大學(xué)的工程師開發(fā)的 Occamy 處理器現(xiàn)已流片。它使用了兩個(gè) 216 個(gè) 32 位 RISC-V 內(nèi)核的 chiplet 小芯片、未知數(shù)量的 64

2023-05-13 08:44:36

RT-Thread Studio（對芯來科技RISC-V處理器內(nèi)核開發(fā)的全面支持

的處理器指令集，是構(gòu)建芯片生態(tài)和發(fā)展芯片技術(shù)的核心部分，其重要性不言而喻。在此背景下，RISC-V有望成為新的選擇。盡管具有通用、開放與免費(fèi)的先期優(yōu)勢，但相比已經(jīng)成熟的Arm和Intel x86，國內(nèi)

2020-11-14 09:26:41

[轉(zhuǎn)]基于開源歐拉 openEuler 的 RISC-V 商業(yè)發(fā)行版正式發(fā)布

、SW64、Power 六大處理器架構(gòu)。傲來 2.0-RV 聚焦 RISC-V 指令集，可提供桌面、模擬器、硬件板卡等多種運(yùn)行環(huán)境。中國工程院倪光南院士在主題發(fā)言中表示，openEuler 社區(qū)

2022-12-29 09:39:02

openEuler 加入 RISC-V Landscape，相關(guān)技術(shù)已完成生態(tài)適配

RISC-V 架構(gòu)處理器上的更多可能。今年 2 月，[RISC-V SIG 成功在賽昉科技的 VisionFive 2 開發(fā)板上適配歐拉操作系統(tǒng)]，openEuler RISC-V 22.03 V

2023-03-16 15:10:13

?GPU，RISC-V的長痛

具備與多種處理器架構(gòu)協(xié)同工作的潛質(zhì)，其B系列更是可以達(dá)到最高6TFLOPS的算力，對于視覺計(jì)算優(yōu)異但3D圖形處理仍然偏科的RISC-V來說，可以說是一個(gè)很好的輔助，尤其是對于圖形性能有一定要求的消費(fèi)類

2022-03-24 15:53:12

【已發(fā)獎(jiǎng)】RISC-V CON China在線研討會(huì)：818 RISC-V 如何成為芯主流

盡快聯(lián)系我們！另外，研討會(huì)的PPT也已經(jīng)開放下載了！開源指令集架構(gòu)(ISA) RISC-V近年迅速興起，并躍為新一代主流嵌入式處理器技術(shù)，生態(tài)系蓬勃發(fā)展，特別適合AI、IoT、5G等新興應(yīng)用。晶心

2021-08-18 13:55:33

【年度技術(shù)專場】RISC-V項(xiàng)目分享會(huì)

?。前云天勵(lì)飛市場中心總經(jīng)理；前SiFive China市場開發(fā)總監(jiān)；前國科微電?副總裁；前全志科技營銷總監(jiān)等。議題四擴(kuò)展RISC-V 的芯邊界-Andes最新的處理器核介紹RISC-V國際協(xié)會(huì)自

2023-01-06 14:27:42

【轉(zhuǎn)載】RISC-V 能打 50 年！risc-v 現(xiàn)在和未來的發(fā)展

如何平衡開源與商業(yè)化之間的矛盾？帶著這樣的疑問，《程序員》特別對話 RISC-V International 首席技術(shù)官 Mark Himelstein。通過本文，或許我們可以走進(jìn) RISC-V 的世界

2023-02-27 20:02:18

一些關(guān)于RISC-V的質(zhì)疑與解讀

，在美國開發(fā)的開源RISC-V處理器（不考慮托管平臺(tái)的因素），也是不會(huì)受到美國出口管制。RISC-V基金會(huì)負(fù)責(zé)指令集規(guī)范的定義，但并不負(fù)責(zé)基于指令集規(guī)范的具體實(shí)現(xiàn)。因此，即使RISC-V基金會(huì)總部留在

2020-06-22 16:49:27

兩大架構(gòu)RISC-V 和 ARM 的各種關(guān)系

，然后返回到內(nèi)存中。RISC-V 和 ARM 都支持 32 位或 64 位指令集。二、RISC-V 和 ARM 的區(qū)別盡管 RISC-V 和 ARM 處理器技術(shù)的功能相似，但也有顯著區(qū)別。 1.

2023-06-21 20:31:32

中科院發(fā)布“香山”與“傲來”兩項(xiàng)開源處理器芯片

中科院計(jì)算技術(shù)研究所副所長包云崗介紹了目前全球性能最高的開源高性能RISC-V處理器核項(xiàng)目“香山”。他指出，計(jì)算技術(shù)研究所對標(biāo)ARM Cortex-A72，已于2021年成功研制出第一代“香山

2023-05-28 08:43:00

為什么選擇RISC-V？

RISC-V是一種開放式ISA（指令集體系結(jié)構(gòu)），為處理器體系結(jié)構(gòu)的創(chuàng)新開創(chuàng)了新紀(jì)元。RISC-V基金會(huì)由325多家成員公司組成。這是該技術(shù)的主要優(yōu)勢。軟件架構(gòu)師/固件工程師/軟件開發(fā)

2020-07-27 17:38:30

什么是RISC-V

siFive搞RISC-V 賽昉搞RISC-V 香山搞RISC-V 到底什么是RISC-V？先不問有什么用，RISC-V目前的能力來說，工業(yè)有沒有可能？

2024-02-02 10:41:21

什么是RISC-V？ RISC-V指令具有哪些特點(diǎn)應(yīng)用？

什么是RISC-V？RISC-V指令具有哪些特點(diǎn)應(yīng)用？自己怎么才能設(shè)計(jì)出設(shè)計(jì)一套指令集？

2021-10-14 09:05:03

從零開始寫RISC-V處理器之一二前言緒論

并不多，也就是晚上下班后和周末玩玩，自己照著芯片手冊寫了幾個(gè)例程在板子上跑跑而已。再后來發(fā)現(xiàn)網(wǎng)上已經(jīng)有如何設(shè)計(jì)RISC-V處理器的書籍賣了，并且這個(gè)處理器是開源的，于是果斷買了一本來閱讀并瀏覽了它的開源

2022-08-22 18:25:55

從零開始寫RISC-V處理器之六寫在最后

來源：liangkangnan的博客更新于 2021-01-31tinyriscv 一個(gè)從零開始寫的極簡易懂的RISC-V處理器核從零開始寫RISC-V處理器之一前言從零開始寫RISC-V處理器

2022-08-23 15:05:44

優(yōu)化的關(guān)鍵，RISC-V中的性能監(jiān)控

分析/監(jiān)控工具成了處理器開發(fā)時(shí)必不可少的軟件。盡管RISC-V的ISA規(guī)范已經(jīng)定義了硬件性能監(jiān)控(HPM)，但總體支持程度上仍未完善。就以Linux上的性能分析工具Perf為例，該工具可以借助PMU

2021-12-27 08:00:00

全球首個(gè)可運(yùn)行Linux的全開源RISC-V微型電腦系統(tǒng)PicoRio項(xiàng)目

操作系統(tǒng)核心軟件全部開源，核心架構(gòu)使用最新的開源RISC-V指令集技術(shù)。除高質(zhì)量工業(yè)級的開源IP之外，PicoRio還將提供開源的參考SoC設(shè)計(jì)，以及詳盡的集成文檔。 PicoRio基于開源的處理器

2020-07-27 19:39:16

關(guān)于RISC-V和開源處理器的一些解讀

版的處理器實(shí)現(xiàn)（如國內(nèi)平頭哥玄鐵910、芯來N200核與優(yōu)矽渭河WH-32核等）。（詳見第三節(jié)）一、關(guān)于近期一篇網(wǎng)絡(luò)文章的分析近日，網(wǎng)絡(luò)上出現(xiàn)一篇文章《RISC-V董事長攤牌了，RISC-V不是開源處理器

2020-06-22 16:47:55

初探RISC-V—《RISC-V體系結(jié)構(gòu)編程與實(shí)踐》

之后，我對RISC-V體系結(jié)構(gòu)的理解有了很大的提升。本書的最大特色就是實(shí)踐屬性，書中的實(shí)驗(yàn)和代碼示例非常有用。書中配合有大量的示例代碼和實(shí)驗(yàn)，這些實(shí)驗(yàn)都利用了開源的RISC-V模擬器，可以讓讀者更好地理

2023-03-28 11:41:50

基于 RISC-V 的微控制器入門指南

基于 RISC-V 處理器的開發(fā)板。LoFive FE310 開發(fā)板GroupGets LLC 的 LoFive-R1 開發(fā)板正是其中之一（圖 1）。首先，LoFive R1 包含的 RISC-V

2020-08-21 18:35:32

如何在RISC-V處理器上使用FreeRTOS？

RISC-V指令集體系結(jié)構(gòu)(ISA)易于擴(kuò)展，并且沒有指定關(guān)于特定RISC-V微控制器或片上系統(tǒng)(SoC)實(shí)現(xiàn)的所有內(nèi)容。因此，F(xiàn)reeRTOS RISC-V移植也是可擴(kuò)展的-它提供了一個(gè)處理所有

2019-11-29 15:54:41

學(xué)習(xí)RISC-V入門基于RISC-V架構(gòu)的開源處理器及SoC研究

Waterman、Yunsup Lee決定設(shè)計(jì)一種新的指令級架構(gòu)，并決定以BSD授權(quán)的方式開源，希望借此可以有更多創(chuàng)新的處理器產(chǎn)生、有更多的處理器開源，并以此降低電子產(chǎn)品成本[2]。RISC-V自2014年

2020-07-27 18:09:27

對于RISC-V，我們對它有些誤解？

小組，開展了一個(gè)3個(gè)月的暑期小項(xiàng)目設(shè)計(jì)新的指令集，目標(biāo)是新的指令集能滿足從微控制器到超級計(jì)算機(jī)等各種尺寸的處理器。具體地說，RISC-V指令集架構(gòu)簡單、完全開源并且免費(fèi)，將基準(zhǔn)指令和擴(kuò)展指令分開，可以

2020-08-02 12:01:03

干貨：教科書級透徹分析 RISC-V

。具體內(nèi)容詳見https://github.com/SI-RISCV/e200_opensource/tree/master/doc蜂鳥 RISC-V 開源處理器軟硬件演示視頻本次直播中涉及到的技術(shù)

2020-07-27 17:50:25

開發(fā)出商用的RISC-V處理器還需要哪些開發(fā)工具和環(huán)境？

開發(fā)出商用的RISC-V處理器還需要哪些開發(fā)工具和環(huán)境？ 處理器是軟硬件的交匯點(diǎn)，所以必須有完善的編譯器、開發(fā)工具和軟件開發(fā)環(huán)境（IDE），處理器內(nèi)核才能夠被用戶順利使用起來。目前RISC-V具有

2023-11-18 06:05:15

我了解的RISC-V

使用，同時(shí)也容許企業(yè)添加自有指令集拓展而不必開放共享以實(shí)現(xiàn)差異化發(fā)展。架構(gòu)簡單 RISC-V架構(gòu)秉承簡單的設(shè)計(jì)哲學(xué)。體現(xiàn)為：在處理器領(lǐng)域，主流的架構(gòu)為x86與ARM架構(gòu)。x86與ARM架構(gòu)的發(fā)展的過程

2023-03-19 10:52:16

有哪些RISC-V和GPU結(jié)合的開源項(xiàng)目

請問有哪些RISC-V和GPU結(jié)合的開源項(xiàng)目

2023-04-14 15:41:52

求助，ULP RISC-V協(xié)處理器周期性喚醒的BUG怎么處理？

協(xié)處理器進(jìn)行g(shù)pio操作，執(zhí)行完成后 ULP RISC-V 協(xié)處理器退出，等待下一個(gè)ULP喚醒周期。可當(dāng)在主MCU程序中使能 esp_sleep_enable_ulp_wakeup() 函數(shù)后，每當(dāng)

2023-02-09 06:52:26

淺談RISC-V

的譚姓學(xué)生宣稱的“技術(shù)上看，RISC-V 相比Arm架構(gòu)處理器功耗低 5-6倍、面積效率提升5倍“ 看看笑笑就好，這種PR的話就別當(dāng)真了，真要當(dāng)真了你該懷疑這位加州大學(xué)伯克利分校的高材生的水平

2018-09-11 17:44:01

潤開鴻基于高性能RISC-V開源架構(gòu)DAYU800通過OpenHarmony兼容性測評

近期，江蘇潤開鴻數(shù)字科技有限公司（以下簡稱“潤開鴻”）基于高性能RISC-V開源架構(gòu)處理器研發(fā)的OpenHarmony標(biāo)準(zhǔn)系統(tǒng)開發(fā)平臺(tái)HH-SCDAYU800通過OpenHarmony 3.2.2

2023-12-14 17:33:50

科普RISC-V生態(tài)架構(gòu)(認(rèn)識(shí)RISC-V)

2020-08-02 11:50:33

設(shè)計(jì)一個(gè)risc-v芯片流程是什么？

我非常想了解如果想設(shè)計(jì)一個(gè)類似risc-v的處理器，整個(gè)開發(fā)流程是怎樣的？

2023-12-09 18:39:01

請問risc-v處理器在什么場景和行業(yè)應(yīng)用比較多？

如題，現(xiàn)在risc-v發(fā)展的如此迅猛，不知道這些處理器主要應(yīng)用在哪些行業(yè)比較多呢？

2023-12-09 18:37:01

請問ESP32s3 ULP RISC-V協(xié)處理器是否支持ADC的讀取？

我在ULP RISC-V協(xié)處理器的例程中，沒有發(fā)現(xiàn)有對ADC的操作，請問RISC-V協(xié)處理器目前還不支持嗎？使用的IDF版本為4.4.2。我想在ULP模式下，通過ADC來讀取外部器件的數(shù)據(jù)。

2023-02-13 06:34:36

請問ESP32s3 ULP RISC-V協(xié)處理器是否支持ADC的讀取？

2023-03-06 06:33:44

讀《玄鐵RISC-V處理器入門與實(shí)戰(zhàn)》

是由美國伯克利大學(xué)的 Krest 教授及其研究團(tuán)隊(duì)提出的，當(dāng)時(shí)提出的初衷是為了計(jì)算機(jī)/電子類方向的學(xué)生做課程實(shí)踐服務(wù)的。由于這是伯克利大學(xué)研究并流片的第五代RISC架構(gòu)處理器，因此就命名為RISC-V

2023-09-28 11:58:35

讀書分享會(huì) | 玄鐵RISC-V處理器入門與實(shí)戰(zhàn)電子書免費(fèi)下載！

。RISC-V的開源性質(zhì)意味著任何人都可以使用、修改和共享該架構(gòu)，這在當(dāng)前計(jì)算機(jī)科學(xué)領(lǐng)域引起了廣泛的關(guān)注。本書分為多個(gè)章節(jié)，從RISC-V的概念和基礎(chǔ)開始，逐步深入講解了玄鐵處理器硬件結(jié)構(gòu)、指令集、內(nèi)存管理

2023-04-12 11:16:58

賽昉科技成立RISC-V Multimedia SIG，推動(dòng)openKylin on RISC-V生態(tài)發(fā)展

openKylin開源多媒體框架在RISC-V架構(gòu)平臺(tái)的集成和適配。完成并實(shí)現(xiàn)openKylin軟硬件編碼器在RISC-V平臺(tái)的成功運(yùn)行。02 SIG職責(zé)1 、適配開源多媒體框架在openKylin操作系統(tǒng)上

2023-04-03 18:33:36

阿里平頭哥宣布開源玄鐵RISC-V系列處理器

10月19日，在2021云棲大會(huì)上，阿里云智能總裁張建鋒宣布，平頭哥開源玄鐵RISC-V系列處理器，并開放系列工具及系統(tǒng)軟件。這是系列處理器與基礎(chǔ)軟件的首次全棧開源，將推動(dòng)RISC-V架構(gòu)走向成熟

2021-10-20 14:09:00

首席技術(shù)官Alessandro Piovaccari近期接受行業(yè)媒體的專訪時(shí)，分享了對于RISC-V發(fā)展的觀點(diǎn)

2020-10-13 16:40:41

香山處理器 RISC-V的典范

https://github.com/JiaoXianjun/XiangShan談到RISC-V，應(yīng)該都會(huì)想到香山處理器。其經(jīng)歷了幾代的演進(jìn)，性能越來越高。采用Chisel Rocketchip框架，能夠方便的定制屬于你的RISC-V處理器。對此，你有什么看法？

2023-04-14 15:51:59

香山是什么？“香山” 高性能開源 RISC-V 處理器項(xiàng)目介紹

香山是什么2019 年，在中國科學(xué)院支持下，由中國科學(xué)院計(jì)算技術(shù)研究所牽頭發(fā)起 “香山” 高性能開源 RISC-V 處理器項(xiàng)目，研發(fā)出目前國際上性能最高的開源高性能 RISC-V 處理器核

2022-04-07 14:20:44

開源的處理器？這臺(tái)國產(chǎn) RISC-V 架構(gòu)單板電腦表現(xiàn)如何

處理器嵌入式RISCRISC-V

Powersee發(fā)布于 2022-09-23 11:35:45

開源入侵芯片領(lǐng)域，RISC-V能創(chuàng)造新的處理器

大型技術(shù)公司已開始涉足RISC-V，該技術(shù)以免費(fèi)標(biāo)準(zhǔn)代替了芯片設(shè)計(jì)過程中的關(guān)鍵專有技術(shù)。盡管RISC-V還處于初期階段，但利用RISC-V卻可能會(huì)創(chuàng)造出一批新的處理器，這些處理器可以與英特爾的產(chǎn)品進(jìn)行競爭，還可以削弱Arm的授權(quán)業(yè)務(wù)。

2020-02-20 16:57:29

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賽昉科技發(fā)布RISC-V天樞系列處理器

現(xiàn)在，對于x86架構(gòu)來講，開源的RISC-V架構(gòu)對其的威脅不斷增加，因?yàn)樗粌H實(shí)現(xiàn)了5GHz超高的頻率，現(xiàn)在多核并行方面也超越了x86。近日，Esperanto公司已經(jīng)實(shí)現(xiàn)了1000核RISC-V處理器。

2020-12-22 15:50:52

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