資料介紹
本應(yīng)用說明描述了一個(gè)參考系統(tǒng),該系統(tǒng)演示了Microblaze?處理器系統(tǒng)中多通道(MCH)片上外圍總線(OPB)雙數(shù)據(jù)速率(DDR)同步DRAM(SDRAM)控制器的使用。MCH OPB DDR SDRAM控制器的兩個(gè)MCH端口連接到Microblaze處理器的緩存端口。端口配置為xilinx cachelink(xcl)協(xié)議,該協(xié)議允許處理器高效地訪問緩存線。該系統(tǒng)包括opb中央dma控制器,用于生成opb順序地址(突發(fā))事務(wù)。此參考系統(tǒng)提供的軟件應(yīng)用程序測(cè)試MCH OPB DDR SDRAM內(nèi)核處理來自微塊處理器的緩存線訪問和來自O(shè)PB中央DMA控制器的OPB突發(fā)事務(wù)的能力。mch opb ddr sdram控制器可以在virtex?-ii pro、spartan?-3和virtex-4 fpgas上實(shí)現(xiàn),其板支持ddr sdram。
本應(yīng)用說明描述如何設(shè)置用于緩存的微時(shí)隙參數(shù)、MCH OPB DDR SDRAM的時(shí)鐘結(jié)構(gòu)以及來自O(shè)PB中央DMA控制器的OPB突發(fā)事務(wù)的參數(shù)。這個(gè)參考系統(tǒng)是針對(duì)錫林克斯SP305斯巴達(dá)-3開發(fā)委員會(huì)。
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