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智能全數字鎖相環的設計
摘要： 在FPGA片內實現全數字鎖相環用途極廣。本文在集成數字鎖相環74297的基礎上進行改進，設計了鎖相狀態檢測電路，配合CPU對環路濾波參數進行動態智能配置，從而使鎖相環快速進入鎖定狀態，在最短時間內正常工作并且提高輸出頻率的質量。
1 引言
數字鎖相環路已在數字通信、無線電電子學及電力系統自動化等領域中得到了極為廣泛的應用。隨著集成電路技術的發展，不僅能夠制成頻率較高的單片集成鎖相環路，而且可以把整個系統集成到一個芯片上去。在基于FPGA的通信電路中，可以把全數字鎖相環路作為一個功能模塊嵌入FPGA中，構成片內鎖相環。
鎖相環是一個相位誤差控制系統。它比較輸入信號和振蕩器輸出信號之間的相位差，從而產生誤差控制信號來調整振蕩器的頻率，以達到與輸入信號同頻同相。所謂全數字鎖相環路(DPLL)就是環路部件全部數字化，采用數字鑒相器（DPD）、數字環路濾波器(DLF)、數控振蕩器(DCO)構成的鎖相環路，其組成框圖見圖1示。
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