資料介紹
本章節(jié)對(duì)改善您系統(tǒng)的信號(hào)完整性,以及在系統(tǒng)中成功實(shí)現(xiàn)LPDDR2SDRAM接口提供了指南。
具有UniPHY知識(shí)產(chǎn)權(quán)(IP)的LPDDR2SDRAM控制器使您能夠?qū)崿F(xiàn)LPDDR2 SDRAM與Arria”V和CycloneV器件之間的接口連接。
本章重點(diǎn)對(duì)影響信號(hào)完整性的以下幾個(gè)主要因素作了介紹:
■I/0標(biāo)準(zhǔn)
■LPDDR2配置
■信號(hào)匹配
■印刷電路板(PCB)布局指南
LPDDR2SDRAM 接口信號(hào)使用HSUL-12JEDECI/0信號(hào)標(biāo)準(zhǔn),具有低功耗和低排放的特性。HSUL-12JEDECI/0標(biāo)準(zhǔn)主要用于點(diǎn)到點(diǎn)的無(wú)端接總線拓?fù)浣Y(jié)構(gòu)。通過(guò)使用此標(biāo)準(zhǔn),在LPDDR2SDRAM實(shí)現(xiàn)中就不再需要外部串行或者并行匹配電阻,并且大大降低了端接功耗,使可編程驅(qū)動(dòng)強(qiáng)度用于匹配阻抗。
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