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FPGA設計的指導原則:這里“面積”指一個設計消耗FPGA/CPLD 的邏輯資源的數量，對于FPGA 可以用所消耗的觸發器（FF）和查找表（LUT）來衡量，更一般的衡量方式可以用設計所占用的等價邏輯門數。“速度”指設計在芯片上穩定運行，所能夠達到的最高頻率，這個頻率由設計的時序狀況決定，和設計滿足的時鐘周期，PAD to PAD Time，Clock Setup Time，Clock Hold Time，Clock-to-Output Delay 等眾多時序特征量密切相關。面積（area）和速度（speed）這兩個指標貫穿著FPGA/CPLD設計的始終，是設計質量的評價的終極標準。這里我們就討論一下關于面積和速度的兩個最基本的概念：面積與速度的平衡和面積與速度的互換。面積和速度是一對對立統一的矛盾體。要求一個同時具備設計面積最小，運行頻率最高是不現實的。更科學的設計目標應該是在滿足設計時序要求（包含對設計頻率的要求）的前提下，占用最小的芯片面積。或者在所規定的面積下，使設計的時序余量更大，頻率跑得更高。這兩種目標充分體現了面積和速度的平衡的思想。關于面積和速度的要求，我們不應該簡單的理解為工程師水平的提高和設計完美性的追求，而應該認識到它們是和我們產品的質量和成本直接相關的。如果設計的時序余量比較大，跑的頻率比較高，意味著設計的健壯性更強，整個系統的質量更有保證；另一方面，設計所消耗的面積更小，則意味著在單位芯片上實現的功能模塊更多，需要的芯片數量更少，整個系統的成本也隨之大幅度削減。
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