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在使用FPGA 時，經(jīng)常忽略了它的一個優(yōu)點——能夠集成時鐘解決方案。這種集成能力
不但降低了系統(tǒng)成本，而且最新的65-nm Altera?Cyclone?III FPGA 支持高級時鐘管理和鎖相環(huán)(PLL)技術(shù)，因此，還極大地提高了設(shè)計靈活性。設(shè)計人員利用Cyclone III 時鐘管理功能，管理整個FPGA 和電路板的時鐘系統(tǒng)。而且，由于Cyclone III PLL 集成在FPGA 中，可以利用Altera的Quartus?II 設(shè)計環(huán)境，輕松進(jìn)行設(shè)置和配置。
關(guān)鍵詞：FPGA，Cyclone III FPGA PLL，集成度
引言
在使用FPGA 時，經(jīng)常忽略了它的一個優(yōu)點——能夠集成時鐘解決方案。這種集成能力不但降低了系統(tǒng)成本，而且最新的65-nm Altera?Cyclone?III FPGA 支持高級時鐘管理和鎖相環(huán)(PLL)技術(shù)，因此，還極大地提高了設(shè)計靈活性。設(shè)計人員利用Cyclone III 時鐘管理功能，管理整個FPGA和電路板的時鐘系統(tǒng)。而且，由于Cyclone III PLL 集成在FPGA 中，可以利用Altera 的Quartus?II設(shè)計環(huán)境，輕松進(jìn)行設(shè)置和配置。
不但降低了系統(tǒng)成本，而且最新的65-nm Altera?Cyclone?III FPGA 支持高級時鐘管理和鎖相環(huán)(PLL)技術(shù)，因此，還極大地提高了設(shè)計靈活性。設(shè)計人員利用Cyclone III 時鐘管理功能，管理整個FPGA 和電路板的時鐘系統(tǒng)。而且，由于Cyclone III PLL 集成在FPGA 中，可以利用Altera的Quartus?II 設(shè)計環(huán)境，輕松進(jìn)行設(shè)置和配置。
關(guān)鍵詞：FPGA，Cyclone III FPGA PLL，集成度
引言
在使用FPGA 時，經(jīng)常忽略了它的一個優(yōu)點——能夠集成時鐘解決方案。這種集成能力不但降低了系統(tǒng)成本，而且最新的65-nm Altera?Cyclone?III FPGA 支持高級時鐘管理和鎖相環(huán)(PLL)技術(shù)，因此，還極大地提高了設(shè)計靈活性。設(shè)計人員利用Cyclone III 時鐘管理功能，管理整個FPGA和電路板的時鐘系統(tǒng)。而且，由于Cyclone III PLL 集成在FPGA 中，可以利用Altera 的Quartus?II設(shè)計環(huán)境，輕松進(jìn)行設(shè)置和配置。
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