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文中提出了一種基于FPGA—IP核的FFT算法硬件模塊的設(shè)計(jì)方案，該方案采用四分塊遞
推FFT算法，具有結(jié)構(gòu)規(guī)范、遞推性好、實(shí)時(shí)性強(qiáng)等特點(diǎn)，結(jié)合DSP對(duì)模塊的數(shù)據(jù)輸入和輸出的軟
件控制，實(shí)現(xiàn)了一種硬件和軟件相結(jié)合的實(shí)時(shí)FFT模塊。對(duì)該模塊性能進(jìn)行測(cè)試，F(xiàn)FT模塊運(yùn)行
穩(wěn)定，輸出的計(jì)算結(jié)果正確，與DSP軟件實(shí)現(xiàn)的標(biāo)準(zhǔn)FFT算法程序庫相比，文中的FFT模塊實(shí)時(shí)
性能提高了35倍，該模塊巳被用于實(shí)時(shí)信號(hào)處理系統(tǒng)中。
推FFT算法，具有結(jié)構(gòu)規(guī)范、遞推性好、實(shí)時(shí)性強(qiáng)等特點(diǎn)，結(jié)合DSP對(duì)模塊的數(shù)據(jù)輸入和輸出的軟
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