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目前，基于FPGA 的嵌入式CPU核的設(shè)計已成為SOC設(shè)計的重要部分．提出一種嵌入式CPU核的VHDI 行為建模方法，與傳統(tǒng)的基于電路結(jié)構(gòu)建模的CPU核的設(shè)計方法不同，新的VHDI 建摸方法是基于指令對數(shù)據(jù)流流通控制行為的描述．使用這種方法可以快速建創(chuàng)建兼容已有指令集的CPU核的VHDL模型，易于修改，提高設(shè)計效率．同時介紹了兼容8051單片機指令的CPU 的vHDL設(shè)計例子，并給出使用ISE7．1工具在Xilinx的Sparten 3器件上進行綜合實現(xiàn)CPU核設(shè)計的結(jié)果和使用Modesim6．0工具進行指令操作仿真的結(jié)果．仿真的結(jié)果顯示該建模方法是可行的，設(shè)計的CPU核可以運行在125 MHZ時鐘工作頻率，指令執(zhí)行速度超過40 MIPS．
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