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學習內容：使用HDL設計的先進性，Verilog的主要用途，Ⅴerilog的歷史如何從抽象級（ levels of abstraction）理解，電路設計，Ⅴerilog描述
·硬件描述語言HDL：描述電路硬件及時序的一種編程語言·仿真器：讀入HDL并進行解釋及執行的一種軟件抽象級：描述風格的詳細程度，如行為級和門級ASIC：專用集成電路（ Application Specific Integrated CircuitASIC Vender：芯片制造商，開發并提供單元庫自下而上的設計流程：一種先構建底層單元，然后由底層單元構造更大的系統的設計方法。自頂向下的設計流程：一種設計方法，先用高抽象級構造系統然后再設計下層單元·RTL級：寄存器傳輸級（ Register Transfer level，用于設計的可綜合的一種抽象級Tcl： Tool command language，向交互程序輸入命令的描述語言
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