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電子發燒友網>電子資料下載>嵌入式開發>基于PCI橋接IP Core的VeriIog HDL實現

基于PCI橋接IP Core的VeriIog HDL實現

2017-10-31 | rar | 0.19 MB | 次下載 | 免費

資料介紹

  PCI總線具有高數據傳輸率、獨立于處理器、并且支持多功能外設等一系列獨特的性能,越來越受到各行業的重視 ,使得 PCI總線接 口非常普及 ,但是仍然有很多非 PCI接口的設備存在,這就需要通過具有 PCI橋接功能的IPCore來實現總線協議的轉接,從而完成設備本身的功能。2 PCIV2.2簡介PCI總線如果只作為 目標設備至少需要47條接口信號線,如果作為主設備則至少需要 49條,也就是要加上一個 REQ}}和 GNT#來進行仲裁判斷。其中這些信號線主要包括數據/地址線、接口控制線、仲裁、總線命令以及系統信號線。對于 32bit的信號寬度,一次數據交易都是由一個地址周期和一 個或者幾個數據周期組成的。在每個 PCI交程中,主要的控制信號有:幀周期信號 FRAME#、字節使能 C/BE#、主設備準備好信號 IRDY#、目標設備準備好信號 TRDY#、設備選擇信號 DESEL#。利用這些信號便可處理數據、地址、實現接口控制、仲裁及系統功能。PCI總線傳輸的幾個基本特點:(1)數據傳輸 時主設 備驅動 AD 上 的地址和C/BE#上的命令 ,同時主設備有效 FRAME#表 明交易開始。而總線上的所有 目標開始采樣地址命令和FRAME#,并開始譯碼確定是不是對本機 的訪問,同時從命令字中識別該交易是讀操作還是寫操作 ;(2)讀寫交易根據控制信號 IRDY#,TRDY#,DESEL#以及 FRAME#的狀態來控制交易的進行和終止;(3)如果對于主設備或者 目標設備 中的任何一個沒有足夠的能力來完成交易則可以通過插入等待周期來中斷本次交

PCI橋接IP Core的VeriIog HDL實現

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