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FIFO是FPGA處理跨時鐘和數據緩存的必要IP，可以這么說，只要是任意一個成熟的FPGA涉及，一定會涉及到FIFO。但是我在使用異步FIFO的時候，碰見幾個大坑，這里總結如下，避免后來者入坑。
注意點
這里博主主要總結兩個注意點，也是最常入坑的點：
1、異步FIFO的讀寫計數不準，經常可以碰見FIFO的空標志拉高，但是計數器顯示FIFO中還有數據的情況，所以使用FIFO自帶的計數器時，一定要小心，只可以使用大概范圍，不可以使用精確范圍。
2、異步FIFO在復位一段時間后，才可以繼續操作，不可以復位后立馬把讀寫使能拉高，因為異步FIFO需要一定的時間進行同步操作。
3、FIFO復位后需要一些時鐘之后，才可以進行正常的讀寫工作。
4、異步FIFO寫數據需要經過10個左右的時鐘才能從正確讀出，這里一定要流出足夠的時鐘周期，否則會發生錯誤。
上面的兩點一定要注意，否則很容易跳入一個大坑。當然，同步FIFO沒有上述的問題。
來源：電子創新網
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