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SN65LVDS301 串行器器件將 27 個并行數據輸入轉換 為 1、2 或 3 個次低壓差分信號 (SubLVDS) 串行輸 出。它從并行 CMOS 輸入接口加載具有 24 個像素位 和 3 個控制位的移位寄存器。除了 27 個數據位，該器 件還在 30 位數據字中添加了一個奇偶校驗位和兩個保 留位。每個字通過像素時鐘 (PCLK) 鎖存到器件中。奇 偶校驗位（奇校驗）使接收器能夠檢測 single-bit 錯 誤。串行移位寄存器的上傳速率為像素時鐘數據速率的 30、15 或 10 倍，具體取決于所使用的串行鏈路數。 像素時鐘的一個副本會通過單獨的差分輸出進行輸出。 FPC 布線通常將 SN65LVDS301 與顯示屏互連。與并 行信號相比，LVDS301 輸出顯著降低了 20dB 以上互 連的 EMI。器件本身的電磁輻射非常低，符合 SAE J1752/3 'M' 技術規范。
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