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基于SRAM 和DRAM 結構的大容量FIFO 的設計與實現
作者：楊奇 楊瑩
摘要：本文分別針對Hynix 公司的兩款SRAM 和DRAM 器件，介紹了使用CPLD 進行接口
連接和編程控制，來構成低成本、大容量、高速度FIFO 的方法。該方法具有通用性，可以方便地移植到與其他RAM 器件相連的應用中去。
關鍵詞：CPLD，SRAM，DRAM，FIFO
1 引言
FIFO(First In First Out)是一種具有先進先出存儲功能的部件，在高速數字系統當中通常用作數據緩存。在高速數據采集、傳輸和實時顯示控制領域中，往往需要對大量數據進行快速存儲和讀取，而這種先進先出的結構特點很好地適應了這些要求，是傳統RAM 無法達到的。許多系統都需要大容量FIFO 作為緩存，但是由于成本和容量限制，常采用多個FIFO 芯片級聯擴展，這往往導致系統結構復雜，成本高。本文分別針對Hynix 公司的兩款SRAM 和DRAM 器件，介紹了使用CPLD 進行接口連接和編程控制，來構成低成本、大容量、高速度FIFO 的方法。該方法具有通用性，可以方便地移植到與其他RAM 器件相連的應用中去。
作者：楊奇 楊瑩
摘要：本文分別針對Hynix 公司的兩款SRAM 和DRAM 器件，介紹了使用CPLD 進行接口
連接和編程控制，來構成低成本、大容量、高速度FIFO 的方法。該方法具有通用性，可以方便地移植到與其他RAM 器件相連的應用中去。
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1 引言
FIFO(First In First Out)是一種具有先進先出存儲功能的部件，在高速數字系統當中通常用作數據緩存。在高速數據采集、傳輸和實時顯示控制領域中，往往需要對大量數據進行快速存儲和讀取，而這種先進先出的結構特點很好地適應了這些要求，是傳統RAM 無法達到的。許多系統都需要大容量FIFO 作為緩存，但是由于成本和容量限制，常采用多個FIFO 芯片級聯擴展，這往往導致系統結構復雜，成本高。本文分別針對Hynix 公司的兩款SRAM 和DRAM 器件，介紹了使用CPLD 進行接口連接和編程控制，來構成低成本、大容量、高速度FIFO 的方法。該方法具有通用性，可以方便地移植到與其他RAM 器件相連的應用中去。
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