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FPGA設(shè)計論壇

文章:400 被閱讀:110.1w 粉絲數(shù):56 關(guān)注數(shù):0 點贊數(shù):21

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FPGA設(shè)計的常用基本時序路徑分析

該條路徑包括了觸發(fā)器內(nèi)部clock-to-Q的延遲,觸發(fā)器之間的由組合邏輯造成的路徑延遲以及目標(biāo)觸發(fā)....
的頭像 FPGA設(shè)計論壇 發(fā)表于 01-18 16:31 ?859次閱讀
FPGA設(shè)計的常用基本時序路徑分析

FPGA芯片下游行業(yè)的發(fā)展情況和趨勢

通信行業(yè)一直是FPGA芯片的重要應(yīng)用領(lǐng)域,芯片在通信設(shè)備中的應(yīng)用主要包括數(shù)字信號處理、協(xié)議處理、射頻....
的頭像 FPGA設(shè)計論壇 發(fā)表于 01-17 16:50 ?952次閱讀

PCIE相關(guān)概念和帶寬計算方法

傳輸速率為每秒傳輸量GT/s,而不是每秒位數(shù)Gbps,因為傳輸量包括不提供額外吞吐量的開銷位;比如 ....
的頭像 FPGA設(shè)計論壇 發(fā)表于 01-16 14:42 ?1484次閱讀
PCIE相關(guān)概念和帶寬計算方法

怎么用FPGA做算法 如何在FPGA上實現(xiàn)最大公約數(shù)算法

FPGA算法的優(yōu)點在于它們可以提供高度的定制化和靈活性,使得算法可以根據(jù)實際需求進行優(yōu)化和調(diào)整。此外....
的頭像 FPGA設(shè)計論壇 發(fā)表于 01-15 16:03 ?2566次閱讀

什么是CXL技術(shù)?CXL的三種模式、類型、應(yīng)用

CXL的目標(biāo):解決CPU和設(shè)備、設(shè)備和設(shè)備之間的內(nèi)存鴻溝。服務(wù)器有巨大的內(nèi)存池和數(shù)量龐大的基于PCI....
的頭像 FPGA設(shè)計論壇 發(fā)表于 01-11 16:53 ?2398次閱讀
什么是CXL技術(shù)?CXL的三種模式、類型、應(yīng)用

FPGA硬件電路的調(diào)試必備原則和技巧

在調(diào)試FPGA電路時要遵循必須的原則和技巧,才能降低調(diào)試時間,防止誤操作損壞電路。通常情況下,參考以....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-22 16:40 ?919次閱讀
FPGA硬件電路的調(diào)試必備原則和技巧

浮點LMS算法的FPGA實現(xiàn)

引言 LMS(最小均方)算法因其收斂速度快及算法實現(xiàn)簡單等特點在自適應(yīng)濾波器、自適應(yīng)天線陣技術(shù)等領(lǐng)域....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-21 16:40 ?867次閱讀

如何用內(nèi)部邏輯分析儀調(diào)試FPGA?

1 推動FPGA調(diào)試技術(shù)改變的原因 進行硬件設(shè)計的功能調(diào)試時,F(xiàn)PGA的再編程能力是關(guān)鍵的優(yōu)點。CP....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-20 13:35 ?624次閱讀
如何用內(nèi)部邏輯分析儀調(diào)試FPGA?

詳解從均值濾波到非局部均值濾波算法的原理及實現(xiàn)方式

圖像降噪處理主要分為2D(空域)與3D降噪(時域/多幀),而2D降噪由于相關(guān)的實現(xiàn) 算法 豐富,效果....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-19 16:30 ?1432次閱讀
詳解從均值濾波到非局部均值濾波算法的原理及實現(xiàn)方式

AXI總線協(xié)議總結(jié)

在介紹AXI之前,先簡單說一下總線、 接口 以及協(xié)議的含義 總線、接口和協(xié)議,這三個詞常常被聯(lián)系在一....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-16 15:55 ?932次閱讀

基于FPGA的硬件引腳分配設(shè)計總結(jié)

隨著 FPGA 的不斷發(fā)展,F(xiàn)PGA本身自帶的PCIE硬核的數(shù)量越來越多,本文以ZU11EG為例介紹....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-14 15:45 ?805次閱讀

基于FPGA及模擬電路的模擬信號波形的實現(xiàn)

1 引言 波形發(fā)生器已經(jīng)廣泛的應(yīng)用在通信、控制、測量等各個領(lǐng)域,如鋸齒波、正弦波、方波等波形常用于電....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-12 15:55 ?1107次閱讀

FPGA在高性能計算中的優(yōu)勢及其用例都有哪些?

近年來,現(xiàn)場可 編程 門陣列 ( FPGA ) 因其可定制性、并行處理和低延遲而成為高性能計算 (H....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-09 12:15 ?1276次閱讀
FPGA在高性能計算中的優(yōu)勢及其用例都有哪些?

千兆以太網(wǎng)發(fā)展現(xiàn)狀 千兆以太網(wǎng)技術(shù)優(yōu)勢

以太網(wǎng)其實是我們?nèi)粘I钪卸紩玫降模热绱蠹倚^(qū)里的千兆以太網(wǎng)等。為增進大家對以太網(wǎng)的了解,本文講....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-08 16:40 ?1167次閱讀

FPGA現(xiàn)場可編程門陣列的綜合指南

現(xiàn)場可編程門陣列 (FPGA) 是可以在制造后進行編程和重新編程以實現(xiàn)數(shù)字邏輯功能的半導(dǎo)體器件。
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-07 17:15 ?777次閱讀
FPGA現(xiàn)場可編程門陣列的綜合指南

FPGA為嵌入式設(shè)計帶來了強大的功能與靈活性

盡管 FPGA 為嵌入式設(shè)計帶來了強大的功能與靈活性,但額外的開發(fā)流程也給設(shè)計工作增加了新的復(fù)雜性和....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-07 09:35 ?617次閱讀

FPGA實現(xiàn)基于Vivado的BRAM IP核的使用

Xilinx公司的FPGA中有著很多的有用且對整個工程很有益處的IP核,比如數(shù)學(xué)類的IP核,數(shù)字信號....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-05 15:05 ?1875次閱讀

FPGA圖像處理方法

圖像在采集和傳輸?shù)倪^程中,通常會產(chǎn)生噪聲,使圖像質(zhì)量降低,影響后續(xù)處理。因此須對圖像進行一些圖像濾波....
的頭像 FPGA設(shè)計論壇 發(fā)表于 12-02 13:15 ?1179次閱讀

中國市場FPGA產(chǎn)業(yè)競爭格局現(xiàn)狀分析

全球范圍內(nèi)?FPGA?產(chǎn)業(yè)的興起與發(fā)展可分為兩個階段。 (1)第一階段是 20世紀(jì) 80 年代開始的....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-29 10:10 ?1160次閱讀

簡述Xilinx 7系列FPGA芯片相關(guān)知識

Xilinx 7系列 芯片 應(yīng)用非常廣泛,具有成本低、性能強悍、成熟穩(wěn)定的特點,目前Xilinx( ....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-28 10:20 ?1279次閱讀
簡述Xilinx 7系列FPGA芯片相關(guān)知識

為你的AI芯片從FPGA走向ASIC?

也許你正在為邊緣計算設(shè)計一個嵌入式推理引擎。或者您正在汽車視覺處理方面邁出下一步。又或許你有可以在數(shù)....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-24 15:30 ?652次閱讀
為你的AI芯片從FPGA走向ASIC?

數(shù)據(jù)中心為什么要部署FPGA?

點擊上方 藍字 關(guān)注我們 FPGA 芯片具有靈活性高、應(yīng)用開發(fā)成本低、上市時間短等優(yōu)勢使其應(yīng)用場景覆....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-21 11:50 ?861次閱讀

FPGA學(xué)習(xí)-異步FIFO原型設(shè)計與驗證

? 點擊上方 藍字 關(guān)注我們 ? 第一節(jié):fifo基礎(chǔ) ? ? 內(nèi)容: 1. 掌握FPGA設(shè)計中關(guān)于....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-17 14:00 ?604次閱讀

基于安路PCIe SGDMA 高速數(shù)據(jù)傳輸方案

安路 科技 PH1A系列 FPGA 定位高性價比邏輯器件,針對高帶寬應(yīng)用場景,能夠在保持低功耗的前提....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-16 14:45 ?778次閱讀

半導(dǎo)體存儲器的介紹與分類

何謂半導(dǎo)體存儲器? 半導(dǎo)體存儲器是指通過對半導(dǎo)體電路加以電氣控制,使其具備數(shù)據(jù)存儲保持功能的半導(dǎo)體電....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-15 10:20 ?1746次閱讀
半導(dǎo)體存儲器的介紹與分類

FPGA學(xué)習(xí)-分頻器設(shè)計

分頻器設(shè)計 一:分頻器概念 板載時鐘往往 是 有限個( 50MHZ/100MHZ/24MHZ/60M....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-03 15:55 ?2113次閱讀
FPGA學(xué)習(xí)-分頻器設(shè)計

FPGA學(xué)習(xí)-時序邏輯電路

時序邏輯電路 一 : 觸發(fā)器 1:D 觸發(fā)器 : 時序邏輯電路最小單元 。 (1):D 觸發(fā)器工作原....
的頭像 FPGA設(shè)計論壇 發(fā)表于 11-02 12:00 ?1271次閱讀
FPGA學(xué)習(xí)-時序邏輯電路

基于Xilinx FPGA的PCIE接口實現(xiàn)

點擊上方 藍字 關(guān)注我們 隨著系統(tǒng)性能、功能和帶寬的日益增長,總線技術(shù)也在迅速的發(fā)展。海量存儲,衛(wèi)星....
的頭像 FPGA設(shè)計論壇 發(fā)表于 10-28 16:25 ?2140次閱讀
基于Xilinx FPGA的PCIE接口實現(xiàn)

EDA技術(shù)與FPGA設(shè)計應(yīng)用的詳細闡述

點擊上方 藍字 關(guān)注我們 引言 21世紀(jì)是電子信息產(chǎn)業(yè)主導(dǎo)的知識經(jīng)濟時代,信息領(lǐng)域正在發(fā)生一場巨大變....
的頭像 FPGA設(shè)計論壇 發(fā)表于 10-26 15:25 ?3541次閱讀
EDA技術(shù)與FPGA設(shè)計應(yīng)用的詳細闡述

基于Xilinx FPGA的嵌入式系統(tǒng)設(shè)計

點擊上方 藍字 關(guān)注我們 1 概述 1.1 FPGA的特點及其發(fā)展趨勢 嵌入式系統(tǒng)是一個面向應(yīng)用、技....
的頭像 FPGA設(shè)計論壇 發(fā)表于 10-25 16:30 ?731次閱讀
基于Xilinx FPGA的嵌入式系統(tǒng)設(shè)計
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